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Departamento de electronica Universidad de Alcala

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    Verificación de un sistema de procesado de señales Radar SMR basado en FPGAs

    Datos Generales
    Nombre del Proyecto: 
    Verificación de un sistema de procesado de señales Radar SMR basado en FPGAs
    Acrónimo: 
    VERSISPRORAD
    Tipo de proyecto: 
    Privado
    Referencia: 
    SMR-2009
    Entidad financiadora: 
    INDRA SISTEMAS S.A.
    Fecha de inicio: 
    25 Feb 2009
    Fecha de finalización: 
    2 Jul 2009
    Participantes
    Entidades participantes: 
    UAH
    Investigador Principal: 
    alfredo.gardel
    Investigador principal 2: 
    joseluis.lazaro
    Investigador principal 3: 
    ignacio.bravo

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